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基于TMS320C6711的线阵CCD采集与处理系统
am、flash、fifo等。故必须对系统进行分割，主要目的是保护高速部分，即sdram部分。设计中高速部分（sdram部分）要求信号线尽量短，尽量靠近dsp。本系统中需要使用大量存储器（4片sdram）。dsp与sdram的时钟接口速度很高，为保障信号的完整性，如图3所示，采用图4所示的时钟缓冲器产生4个相同、延迟极小并且一致的时钟，分别接到4片sdram上。这样不但增加了时钟的驱动能力，同时还很好地保证了信号的完整性。为了保护高速信号部分，同时为了防止dsp外设驱动能力的不足，用74lvt162245双向缓冲器实现flash和异步fifo数据线的职责离。 fifo芯片idt7204与dsp连接中图5所示。fifo是异步器件，所以放到ce1空间上。fifo的读信号由xare#、xce1#、xa20、xa21控制。当ad7821信号转换害完成后，由db_int向we#写信号线开始写入fifo；而当fifo半满后，由hf#向dsp的x_int4请求写入dsp。 2.3 dsp与mcu的互连由于dsp的mcbsp接口和mcu（89c52）的uart接口并不一致，所以不能直接把mcbsp当作

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